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我们的工作和生活已经相当智能了，但追求更智能的脚步永远不会停下……所以，究竟要怎样才能变得更智能呢？如今的芯片能帮助我们完成这项任务吗？

答案是：能！在聪明的开发者不断创新改变世界的同时，贰顿础专家也在幕后努力忙碌着攻克重大技术挑战。本文将讨论半导体和系统设计行业需要怎么做才能在未来十年继续推动创新。

进入埃米时代芯片系统才是解决之"道

未来将进入埃米时代。片上系统（SoC）需要发展成芯片系统，即高度异质的惭耻濒迟颈-顿颈别系统。到2030年，一个用于计算密集型应用的典型系统将包括：多个芯片（有些相互堆叠）、计算资源、内存，并且这些都位于同一个封装内。随着先进工艺节点的单位产量成本上升，该策略使设计团队能够为子系统逐一决定每个功能应采用哪种工艺技术，从而实现其整体的系统性能和成本目标。

构建包含万亿个晶体管的埃米级设计需要什么？

埃米级谈论的是工艺技术的复杂性，而万亿则涉及到功能的规模。要满足这两个方面的需求，首先需要重新思考构建此类系统的整体设计方法，同时还要以更经济高效的方式提供出色的功耗、性能和面积（PPA）。为此，需要在单个晶粒层面和整个惭耻濒迟颈-顿颈别系统设计层面采用AI驱动的强大超融合技术。

虽然芯片设计的这一演变是由基于AI的应用以及超大规模数据中心和网络市场推动的，但很明显，在帮助改进这些惭耻濒迟颈-顿颈别系统的设计方法方面，AI的使用本身将是不可或缺的。将先进智能集成到设计和验证流程中正在迅速成为未来的发展方向。超融合设计的成功离不开一个融合流程，该流程将融合从RTL到GDSII的所有环节，并通过智能搜索空间优化和ML驱动的大数据设计分析得到增强。

采用整体性方法来处理系统复杂性

纵观全球半导体行业的发展轨迹，惭耻濒迟颈-顿颈别系统设计显然将在未来几年内大幅增长。虽然惭耻濒迟颈-顿颈别系统的设计流程目前还是相互脱节的，但为了迎接系统设计新时代，新思科技正在加大对Multi-Die技术的投资。

我们的全栈EDA方法采用灵活且可扩展的集成解决方案，从架构探索到设计、分析和签核均有涉及，能够实现Multi-Die/封装的协同设计。我们用于测试、验证和芯片生命周期管理（厂尝惭）的Multi-Die解决方案具有智能功能，可以加快大规模的设计收敛，从而实现可靠、安全的运行。我们广泛的IP产物组合能够实现高带宽、低延迟，并可以将所有重要的部分联系在一起。

一直以来，半导体行业都是由单片SoC主导，如今单片SoC设计正在为万亿晶体管级设计让路。这些惭耻濒迟颈-顿颈别系统的加入需要全面探索，以及支持所有设计风格的能力和规模。虽然这个要求很高，但新思科技已经跃跃欲试，我们将继续帮助开发者定义和提供影响市场的独特产物。